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      7. 可編程邏輯器件的結構和表示方法介紹
        • 發布時間:2022-02-17 18:52:43
        • 來源:
        • 閱讀次數:
        可編程邏輯器件的結構和表示方法介紹
        可編程邏輯器件即PLD,雖然是作為一種通用器件生產的的,但它的邏輯功能是由用戶通過對器件編程來設定的。而且有些PLD的集成度很高,足以滿足設計一般數字系統的需要。這樣就可以又設計人員自行編程而把數字系統“集成”在一片PLD上,而不必制造專用集成電路芯片了。
        1.基本結構
        PLD一般采用“與”和“或’’陣列結構,該結構不受標準系列器件在邏輯功能上的限制。因為任何一個邏輯表達式均可根據邏輯代數簡化為與或表達式。PLD結構框圖如圖1所示。PLD的基本結構是由一級與邏輯電路與一級或邏輯電路來實現。輸入變量經過輸入緩沖求反,產生互補的輸入信號后,被送到與陣列和或陣列,得到所需的乘積項,然后從具有多種輸出方式的輸出結構輸出。輸出端口往往帶有三態門,通過三態門控制數據直接輸出或反饋到輸入端。通過對與、或兩種邏輯陣列進行編程,實現芯片所需的邏輯功能。
        可編程邏輯器件
        圖1 PLD結構框圖
        2.表示方法
        可編程邏輯器件電路表示法與傳統表示法有所不同,主要因為PLD的陣列規模十分龐大,用傳統的方法表示極不方便。圖2中給出了PLD的三種連接方式。連線交叉處有實點的表示硬線連接,也就是固定連接,用戶不可改變;有符號"X"的表示可編程連接,它通常表示此點目前是互連的,即編程熔絲未被燒斷;若交叉點上沒有"X"連線只是單純交叉表示不連接或者是擦除單元。
        可編程邏輯器件
        PLD的連接法
        可編程邏輯器件
        PLD的互補輸出緩沖器
        可編程邏輯器件
        PLD的三態輸出緩沖器
        可編程邏輯器件
        PLD的與門表示法
        可編程邏輯器件
        PLD的或門表示法
        可編程邏輯器件
        PLD的與門省缺表示
        以上就是可編程邏輯器件的結構與表示方法的介紹了,PLD從最初的PROM經歷了可編程邏輯陣列(PLA)、可編程陣列邏輯(PAI。)、通用陣列邏輯(GAL),發展到目前的在系統編程(ISP)器件,不僅簡化了數字系統設計過程、降低成本和系統的體積、提高了系統的可靠性和保密性,而且使用戶的設計、使用、選擇芯片更加方便快捷,從根本上改變了系統的設計方法。
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